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更新日期： 2025-02-20
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靜態時序分析（Static Timing Analysis，STA）是集成電路設計中的一項關鍵技術，它通過分析電路中的時序關系來驗證電路是否滿足設計的時序要求。與動態仿真不同，STA不需要模擬電路的實際運行過程，而是通過分析電路中的各個時鐘路徑、信號傳播延遲等信息來評估設計是否符合時序要求。 1. 靜態時序分析的……

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中芯國際：回顧2024年，展望2025年

更新日期： 2025-02-20
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中芯國際2024年業績復盤與2025年技術布局展望一、2024年核心業績：產能擴張與結構優化驅動營收創新高2024年中芯國際營收首次突破80億美元（同比+27%），其中12英寸晶圓收入占比提升至77%，成為增長核心引擎。盡管全年毛利率受折舊壓力同比下滑1.3pct至18%，但Q4單季毛利率逆勢攀升至22.6%，……

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為什么芯片設計需要算法工程師？

更新日期： 2025-02-20
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在現代芯片設計中，電路設計和算法實現早已密不可分。簡單來說，芯片不僅僅是由門電路和觸發器組成的邏輯結構，更承載著各種復雜功能——例如通信調制解調、信號處理、圖像和視頻編碼解碼等，這些都依賴于高層次的數學和算法知識。跨學科能力的補充傳統的數字電路工程師擅長處理時序、功耗、面……

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如何理解數字芯片設計中的RTL（Register Transfer Level）

更新日期： 2025-02-20
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一、RTL 的基本定義 RTL（寄存器傳輸級）是數字電路設計中對硬件功能進行抽象描述的一種層次。它的“主角”是寄存器和寄存器之間的數據通路，即在一個時鐘周期內，信號會從寄存器輸出，經過組合邏輯運算，最后進入下一級寄存器。為什么叫“寄存器傳輸級” “寄存器”代表……

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DeepSeek-R1大模型論文詳細解讀

更新日期： 2025-02-20
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一、引子最近拜讀了《DeepSeek-R1: Incentivizing Reasoning Capability in LLMs viaReinforcement Learning》，該論文討論了DeepSeek-R1模型，該模型旨在通過強化學習（RL）提升大語言模型（LLM）的推理能力。二、……

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見證電子行業變遷助力薩科微飛速發展——專訪薩科微技術顧問李健雄

更新日期： 2025-02-20
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薩科微slkor技術顧問李健雄在時代的浪潮中，總有一些人以其獨特的經歷和深刻的思考，成為行業發展的引路人。作為國內最早一批從事家電智能控制系統開發的先驅者，清華大學畢業的李健雄老師擁有國內外電子系統研發設計與生產從業經驗，是一位在電子信息行業深耕數十年的資深專家。如今，作為薩科微（www.slkori……

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重磅！薩科微slkor新聞登上美聯社

更新日期： 2025-02-20
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近日，薩科微總經理宋仕強精心撰寫的《光明磊落熠熠生輝——第八屆“川渝同芯會”年會側記》一文，成功登上了美國最大的通訊社——美聯社。這一成果不僅展現了薩科微在行業里的影響力，更為2025年薩科微slkor（m.xjgouwu.cn）海外宣傳工作打了一個好的基礎。總經理宋仕強說：“2025年，我們宣傳重心全力……

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